DDS可调信号发生器Verilog程序设计
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Vending Machine Design
Verilog Programming
Digital Signal Processing Design
Hardware Architecture Design
State Machine Modeling
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该文档包含多个Verilog模块的设计，包括DDS可调信号发生器、七段显示驱动、波形生成和仿真程序。主要模块包括
seven_tube_drive、shift_adjust、show、wave_generate等，涉及信号处理、状态机、波形生成和测试基准设计，旨在实现可调信号的生成和显示。Last edited time
Sep 24, 2024 03:10 PM
实验要求
在DDS课程设计当中，完成以下功能实现：ROM中存储4组波形数据，通过一个按键切换4组波形，切换到哪一种波形，可以对其调节频率，通过两个按键进行控制（一个完成频率加（假设每次递增500HZ），一个完成频率减（假设每次递减500HZ）；也可以对当前波形进行幅度调节，通过一个按键进行控制（假设每次递增1）。
- 搭建设计架构（设计分：5）。
- 为其建模，必须和设计吻合一致（建模分：10）。
- 仿真测试（验证分：10）。
RTL电路模块图
RTL程序设计
dds.v
addr_control.v
adjust_a.v
adjust.v
bin2bcd.v
bus_1.v
check_edge.v
control.v
datlc5620_drive.v
key_filter.v
key_handle.v
seven_tube_drive.v
shift_adjust.v
show.v
wave_generate.v
仿真程序设计
control_tb.v
dds_tb.v
key_handle_tb.v
- show_tb.v
- wave_generate_tb.v
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