5.always_comb

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Verilog
Digital Circuits
Combinational Logic
AI summary
always_comb用于描述复杂电路,内部只能包含赋值语句,允许使用控制语句如ifcase。其特性包括内部覆盖性和对外原子性。case语句可分为unique casepriority case,而for语句则用于循环展开,需确保循环变量的上下界为常数。always_comb可生成电路行为。

电路语句(三):always_comb

always_comb用于描述复杂电路
always_comb内部每条语句都是赋值语句。不能出现电路语句。
always_comb内部描述电路行为。
always_comb有以下性质:
  • 内部覆盖性
  • 对外原子性
    • 阻塞赋值
    always_comb内部允许if,case等控制语句。

    always_comb中的控制语句:case

    case语句常用于描述选择器和译码器。

    unique case

    如果没列举所有情况且没有default,如何?

    priority case

    always_comb中的控制语句:if和for

    ifforalways_comb中的常用语法。

    if

    ifelse用于条件判断。
    case要有default类似,在always_comb中,if也应有else

    for

    for在always_comb中,会被解释为循环展开。
    for相关的语句:breakcontinue
    循环变量的上下界都应为常数。
    forif即可表示行为,也可生成电路。
     
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